do810ABB

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do810 一个有趣的演示是RISC-V CPU（名为VexRiscv）的第二次迭代，演示了使用SpinalHDL的元硬件描述功能带来的增益。，CPU顶层是一个空白骨架，它只提供一些阐述服务、作为信号通过各阶段（stage）的自动流水线、以及各阶段的仲裁接口。

与一个允许在CPU顶层注入硬件的插件注册系统相结合，该方法支持——可以具有相同功能的多个变体、而无需将其集成到CPU代码中的——非常灵活的CPU架构。插件可从简单的事情（例如程序计数器或整数ALU）到复杂的操作（例如通过L1缓存的加载和存储支持）。

插件之间的合作也可能非常复杂。例如，所有插件都可以发布新的指令操作码，以及如何由指令解码器进行解码。

然后，指令解码器将使用与SpinalHDL元硬件功能相结合的Quine-Mc Cluskey算法来生成小指令解码逻辑。
do810 使用SpinalHDL是改变数字硬件设计愿景并实现真正工程化的一种体验。凭借其所有功能，它允许芯片设计人员描述优雅和可重复使用的硬件，而没有通常使用的HDL（如VHDL、Verilog甚至System-Verilog）的繁琐和限制。它也证明了使用软件工程技术在生成的RTL中没有任何开销就可详细描述硬件结构的可行性和收益。该语言及其参考编译器也是完全免费和开源的。

后，请注意：上述示例中使用的所有功用和类，如Stream、RGB、队列、Apb3Decoder、AxiLite4和AxiLite4SlaveFactory都不是Spinal-HDL语言中提供的功能，而是由标准库使用其常规语法提供。换句话说，可以通过实现新的库、抽象层和可从根本上改善硬件描述表现力的工具来扩展语言本身；也可在不忽视抽象硬件的条件下、通过引入新的概念来扩展语言（因为这些库仍然在RTL域内实现）。
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